本設(shè)計中采用一個5級，16倍抽取，梳狀濾波器延時為1的CIC。用VHDL描述并仿真成功后，即接近一個可用的CIC濾波器。通過在Quartus II平臺上編譯后，可得到仿真結(jié)果，如圖4.2所示。
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